| поискавой системы для электроныых деталей |
|
PSD813F1 датащи(PDF) 82 Page - STMicroelectronics |
|
|
|||||||||||||||||||||||||||||
PSD813F1 датащи(HTML) 82 Page - STMicroelectronics |
|
82 / 110 page ![]() PSD813F1 82/110 Table 48. CPLD Combinatorial Timing (3V devices) Note: 1. Fast Slew Rate output available on PA3-PA0, PB3-PB0, and PD2-PD0. Decrement times by given amount. 2. ZPSD versions only. Figure 43. Synchronous Clock Mode Timing – PLD Symbol Parameter Conditions -15 -20 PT Aloc Turbo Off2 Slew rate1 Unit Min Max Min Max tPD CPLD Input Pin/Feedback to CPLD Combinatorial Output 48 55 + 4 + 20 – 6ns tEA CPLD Input to CPLD Output Enable 43 50 + 20 – 6ns tER CPLD Input to CPLD Output Disable 43 50 + 20 – 6ns tARP CPLD Register Clear or Preset Delay 48 55 + 20 – 6ns tARPW CPLD Register Clear or Preset Pulse Width 30 35 + 20 ns tARD CPLD Array Delay Any macrocell 29 33 + 4 ns tCH tCL tCO tH tS CLKIN INPUT REGISTERED OUTPUT AI02860 |
|
ссылки URL |
| Вашему бизинису помогли Аллдатащит? [ DONATE ] |
Что такое Аллдатащит | реклама | контакт | Конфиденциальность | Ссылка на техническое описание | обмен ссыками | поиск по производителю All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |