TUSB3410 datasheet(9/92 Pages) TI

9 / 92 page

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2–1 Terminal Functions

2–4

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4–1 ROM/RAM Size Definition Table

4–2

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4–2 XDATA Space

4–3

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–3 Memory Mapped Registers Summary

4–4

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4–4 EDB Memory Locations

4–5

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4–5 EDB Entries in RAM

4–6

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4–6 Input/Output EDB-0 Registers

4–10

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6–1 DMA Controller Registers

6–1

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6–2 DMA OUT-Termination Condition

6–3

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6–3 DMA IN-Termination Condition

6–5

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7–1 UART Registers Summary

7–1

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7–2 Transmitter Flow-Control Modes

7–4

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7–3 Receiver Flow-Control Possibilities

7–4

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7–4 DLL/DLH Values and Resulted Baud Rates

7–9

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9–1 8052 Interrupt Location Map

9–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

9–2 Vector Interrupt Values

9–2

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11–1 Device Descriptor

11–3

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11–2 Configuration Descriptor

11–3

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11–3 Interface Descriptor

11–4

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11–4 Output Endpoint1 Descriptor

11–4

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11–5 String Descriptor

11–5

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11–6 USB Descriptors Header

11–8

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11–7 Autoexec Binary Firmware

11–10

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11–8 Host Driver Downloading Format

11–10

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11–9 Bootcode Response to Control Read Transfer

11–14

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11–10 Bootcode Response to Control Write Without Data Stage

11–14

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11–11 Vector Interrupt Values and Sources

11–15

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