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TMS320C6713 датащи(PDF) 2 Page - Texas Instruments |
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2 / 150 page  TMS320C6713, TMS320C6713B FLOATING-POINT DIGITAL SIGNAL PROCESSORS SPRS186I − DECEMBER 2001 − REVISED MAY 2004 2 POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443 Table of Contents EMIF device speed 93 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . EMIF big endian mode correctness [C6713B only] 95 . . . bootmode 96 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . absolute maximum ratings over operating case temperature range 97 . . . . . . . . . . . . . . . . . . . . . . . . . . recommended operating conditions 98 . . . . . . . . . . . . . . . . electrical characteristics over recommended ranges of supply voltage and operating case temperature 99 . parameter measurement information 100 . . . . . . . . . . . . . . signal transition levels 100 . . . . . . . . . . . . . . . . . . . . . . . . . . . timing parameters and board routing analysis 101 . . . . . . input and output clocks 103 . . . . . . . . . . . . . . . . . . . . . . . . . . asynchronous memory timing 107 . . . . . . . . . . . . . . . . . . . . synchronous-burst memory timing 110 . . . . . . . . . . . . . . . . synchronous DRAM timing 112 . . . . . . . . . . . . . . . . . . . . . . . HOLD/HOLDA timing 118 . . . . . . . . . . . . . . . . . . . . . . . . . . . BUSREQ timing 119 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . reset timing 120 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . external interrupt timing 122 . . . . . . . . . . . . . . . . . . . . . . . . . multichannel audio serial port (McASP) timing 123 . . . . . . inter-integrated circuits (I2C) timing 126 . . . . . . . . . . . . . . . host-port interface timing 129 . . . . . . . . . . . . . . . . . . . . . . . . multichannel buffered serial port timing 133 . . . . . . . . . . . . timer timing 143 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . general-purpose input/output (GPIO) port timing 144 . . . . JTAG test-port timing 145 . . . . . . . . . . . . . . . . . . . . . . . . . . . mechanical data 146 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . revision history 149 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . GDP 272-Ball BGA package (bottom view) 3 . . . . . . . . . . . . . PYP PowerPAD QFP package (top view) 8 . . . . . . . . . . . . . description 9 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . device characteristics 10 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . functional block and CPU (DSP core) diagram 12 . . . . . . . . . . CPU (DSP core) description 13 . . . . . . . . . . . . . . . . . . . . . . . . . memory map summary 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . peripheral register descriptions 17 . . . . . . . . . . . . . . . . . . . . . . . signal groups description 26 . . . . . . . . . . . . . . . . . . . . . . . . . . . . device configurations 31 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . configuration examples 38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . debugging considerations 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . terminal functions 46 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . development support 62 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . documentation support 65 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . CPU CSR register description 66 . . . . . . . . . . . . . . . . . . . . . . . . cache configuration (CCFG) register description (13B) 68 . . . interrupts and interrupt selector 69 . . . . . . . . . . . . . . . . . . . . . . . external interrupt sources 71 . . . . . . . . . . . . . . . . . . . . . . . . . . . . EDMA module and EDMA selector 72 . . . . . . . . . . . . . . . . . . . . PLL and PLL controller 75 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . multichannel audio serial port (McASP) peripherals 82 . . . . . I2C 87 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . general-purpose input/output (GPIO) 88 . . . . . . . . . . . . . . . . . . power-down mode logic 89 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . power-supply sequencing 91 . . . . . . . . . . . . . . . . . . . . . . . . . . . . power-supply decoupling 92 . . . . . . . . . . . . . . . . . . . . . . . . . . . . IEEE 1149.1 JTAG compatibility statement 92 . . . . . . . . . . . . . |
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