M68HC08 datasheet(19/288 Pages) FREESCALE

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MC68HC908BD48 — Rev. 2.1

Data Sheet

Freescale Semiconductor

List of Figures

Data Sheet — MC68HC908BD48

List of Figures

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Title

Page

1-1

MCU Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

1-2

44-Pin QFP Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . 29

1-3

42-Pin SDIP Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . 30

2-1

Memory Map. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

2-2

Control, Status, and Data Registers . . . . . . . . . . . . . . . . . . . . . 39

4-1

FLASH Control Register (FLCR) . . . . . . . . . . . . . . . . . . . . . . . 56

4-2

FLASH Programming Flowchart . . . . . . . . . . . . . . . . . . . . . . . . 60

4-3

FLASH Block Protect Register (FLBPR). . . . . . . . . . . . . . . . . . 61

4-4

FLASH Block Protect Start Address . . . . . . . . . . . . . . . . . . . . . 62

5-1

Configuration Register 0 (CONFIG0) . . . . . . . . . . . . . . . . . . . . 64

5-2

Configuration Register 1 (CONFIG1) . . . . . . . . . . . . . . . . . . . . 65

6-1

CPU Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

6-2

Accumulator (A) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

6-3

Index Register (H:X) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

6-4

Stack Pointer (SP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71

6-5

Program Counter (PC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71

6-6

Condition Code Register (CCR) . . . . . . . . . . . . . . . . . . . . . . . . 72

7-1

SIM Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89

7-2

OSC Clock Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91

7-3

External Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

7-4

Internal Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

7-5

Sources of Internal Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

7-6

POR Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

7-7

Interrupt Entry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

7-8

Interrupt Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

7-9

Interrupt Processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99

7-10

Interrupt Recognition Example . . . . . . . . . . . . . . . . . . . . . . . . 100

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