HC805K3GRSSLASHD datasheet(7/119 Pages) NXP

7 / 119 page

General Release Specification

MC68HC805K3 — Rev. 1.0

Section 6. Operational Modes

6.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

6.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

6.3

Low-Power Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

6.3.1

Stop Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

6.3.2

Halt Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56

6.3.3

Wait Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .57

6.3.4

COP Watchdog Timer Considerations . . . . . . . . . . . . . . . .57

Section 7. Parallel Input/Output

7.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .59

7.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .60

7.3

Port A . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .60

7.3.1

Port A Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .61

7.3.2

Port A Data Direction Register . . . . . . . . . . . . . . . . . . . . . .61

7.3.3

Port A Pulldown Inhibit Register . . . . . . . . . . . . . . . . . . . . .61

7.3.4

Port A LED Drive Capability . . . . . . . . . . . . . . . . . . . . . . . .62

7.3.5

Port A I/O Pin Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . .62

7.4

Port B . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63

7.4.1

Port B Data Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63

7.4.2

Port B Data Direction Register . . . . . . . . . . . . . . . . . . . . . .65

7.4.3

Port B Pulldown Inhibit Register . . . . . . . . . . . . . . . . . . . . .65

7.4.4

Port B with 3-Pin RC Oscillator . . . . . . . . . . . . . . . . . . . . . .66

7.5

I/O Port Programming. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .66

7.5.1

Pin Data Direction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .66

7.5.2

Output Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .67

7.5.3

Input Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .67

7.5.4

I/O Pin Transitions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .67

7.5.5

I/O Pin Truth Tables . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .68

Freescale Semiconductor, Inc.

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