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9 / 19 page  EBJ41HE4BDFD, EBJ41HE4BDFM, EBJ41HE4BDFP Data Sheet E1580E30 (Ver. 3.0) 9 Block Diagram RDQS9 RDQ[7:4] /RDQS9 VSS DQ[3:0] D0 /CS DQS /DQS DM ZQ RDQS1 RDQ[11:8] /RDQS1 VSS DQ[3:0] D1 /CS DQS /DQS DM ZQ RDQS2 RDQ[19:16] /RDQS2 VSS DQ[3:0] D2 /CS DQS /DQS DM ZQ RDQS3 RDQ[27:24] /RDQS3 VSS DQ[3:0] D3 /CS DQS /DQS DM ZQ RDQS4 RDQ[35:32] /RDQS4 VSS DQ[3:0] D22 /CS DQS /DQS DM ZQ RDQS5 RDQ[43:40] /RDQS5 VSS DQ[3:0] D23 /CS DQS /DQS DM ZQ RDQS6 RDQ[51:48] /RDQS6 VSS DQ[3:0] D24 /CS DQS /DQS DM ZQ RDQS7 RDQ[59:56] /RDQS7 VSS DQ[3:0] D25 /CS DQS /DQS DM ZQ RDQS8 RCB[3:0] /RDQS8 VSS DQ[3:0] D8 /CS DQS /DQS DM ZQ DQ[3:0] D18 /CS DQS /DQS DM ZQ DQ[3:0] D19 /CS DQS /DQS DM ZQ DQ[3:0] D20 /CS DQS /DQS DM ZQ DQ[3:0] D21 /CS DQS /DQS DM ZQ DQ[3:0] D4 /CS DQS /DQS DM ZQ DQ[3:0] D5 /CS DQS /DQS DM ZQ DQ[3:0] D6 /CS DQS /DQS DM ZQ DQ[3:0] D7 /CS DQS /DQS DM ZQ DQ[3:0] D26 /CS DQS /DQS DM ZQ RDQS0 RDQ[3:0] /RDQS0 VSS DQ[3:0] D9 /CS DQS /DQS DM ZQ RDQS10 RDQ[15:12] /RDQS10 VSS DQ[3:0] D10 /CS DQS /DQS DM ZQ RDQS11 RDQ[23:20] /RDQS11 VSS DQ[3:0] D11 /CS DQS /DQS DM ZQ RDQS12 RDQ[31:28] /RDQS12 VSS DQ[3:0] D12 /CS DQS /DQS DM ZQ RDQS13 RDQ[39:36] /RDQS13 VSS DQ[3:0] D31 /CS DQS /DQS DM ZQ RDQS14 RDQ[47:44] /RDQS14 VSS DQ[3:0] D32 /CS DQS /DQS DM ZQ RDQS15 RDQ[55:52] /RDQS15 VSS DQ[3:0] D33 /CS DQS /DQS DM ZQ RDQS16 RDQ[63:60] /RDQS16 VSS DQ[3:0] D34 /CS DQS /DQS DM ZQ RDQS17 RCB[7:4] /RDQS17 VSS DQ[3:0] D17 /CS DQS /DQS DM ZQ DQ[3:0] D27 /CS DQS /DQS DM ZQ DQ[3:0] D28 /CS DQS /DQS DM ZQ DQ[3:0] D29 /CS DQS /DQS DM ZQ DQ[3:0] D30 /CS DQS /DQS DM ZQ DQ[3:0] D13 /CS DQS /DQS DM ZQ DQ[3:0] D14 /CS DQS /DQS DM ZQ DQ[3:0] D15 /CS DQS /DQS DM ZQ DQ[3:0] D16 /CS DQS /DQS DM ZQ DQ[3:0] D35 /CS DQS /DQS DM ZQ /RCS0 /RCS1 D0 D1 D2 D3 D8 D4 D5 D6 D7 D9 D10 D11 D12 D17 D13 D14 D15 D16 D27 D28 D29 D30 D35 D31 D32 D33 D34 D18 D19 D20 D21 D26 D22 D23 D24 D25 Register /CS0 /CS1 BA[2:0] A[15:0] /RAS /CAS /WE CKE0 CKE1 ODT0 ODT1 Par_In CK0 /CK0 /RESET All SDRAMs R e g i s t e r a n d P L L /RCS0 : Rank0 /RCS1 : Rank1 RBA[2:0] RA[15:0] /RRAS /RCAS /RWE RCKE0 : Rank0 RCKE1 : Rank1 RODT0 : Rank0 RODT1 : Rank1 /Err_Out PCK[3:0] /PCK[3:0] 22 Ω 120 Ω ZQ VSS 240 Ω CK1 /CK1 120 Ω SPD VDDSPD VREFCA All SDRAMs VTT VREFDQ All SDRAMs VSS All SDRAMs VDD All SDRAMs DQS[17:0] DQ[63:0] /DQS[17:0] CB[7:0] RDQS[17:0] RDQ[63:0] /RDQS[17:0] RCB[7:0] /RCS[1:0] RBA[2:0] RA[15:0] /RRAS /RCAS /RWE RCKE[1:0] RODT[1:0] VTT VTT 36 Ω 36 Ω 15 Ω PCK[3:0] /PCK[3:0] 75 Ω A1 SDA SCL A0 A2 /EVENT U1 Serial PD A1 SCL A0 A2 SDA /EVENT Note : 1. DQ wiring may be changed within a nibble. Address, command and control |
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