TVP3026 datasheet(5/107 Pages) TI

5 / 107 page

List of Illustrations

Figure

Title

Page

1–1.

Functional Block Diagram

1–3

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

1–2.

Terminal Assignments

1–4

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–1.

TVP3026 Clocking Scheme

2–8

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–2.

Loop Clock PLL Operation

2–12

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–3.

Typical Configuration – VRAM Clocked by Accelerator

2–16

. . . . . . . . . . . . . . . . . . . . . .

2–4.

Typical Configuration – VRAM Clocked by TVP3026

2–16

. . . . . . . . . . . . . . . . . . . . . . . .

2–5.

Frame-Buffer Timing Without Using SCLK

2–17

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–6.

Frame-Buffer Timing Using SCLK

2–18

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–7.

Frame-Buffer Timing Using SCLK (With First SCLK Pulse Relocated)

2–18

. . . . . . . . .

2–8.

Cursor-RAM Organization

2–32

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–9.

Cursor Positioning

2–33

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–10.

Overscan

2–37

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–11.

CRC Algorithm

2–38

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–12.

Equivalent Circuit of the Current Output (IOG)

2–40

. . . . . . . . . . . . . . . . . . . . . . . . . . . . .

2–13.

Composite Video Output (With 0 IRE, 8-Bit Output)

2–41

. . . . . . . . . . . . . . . . . . . . . . . . .

2–14.

Composite Video Output (With 7.5 IRE, 8-Bit Output)

2–41

. . . . . . . . . . . . . . . . . . . . . . .

3–1.

MPU Interface Timing

3–11

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

3–2.

Video Input /Output Timing

3–12

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

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