STA339BW_V01 datasheet(3/78 Pages) STMICROELECTRONICS

3 / 78 page

DocID15251 Rev 8

3/78

STA339BW

Contents

6.3.2

Multi-byte write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4

Read operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4.1

Current address byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4.2

Current address multi-byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4.3

Random address byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4.4

Random address multi-byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

6.4.5

Write mode sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

6.4.6

Read mode sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

7.1

Configuration register A (addr 0x00) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

7.1.1

Master clock select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

7.1.2

Interpolation ratio select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

7.1.3

Thermal warning recovery bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

7.1.4

Thermal warning adjustment bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

7.1.5

Fault detect recovery bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

7.2

Configuration register B (addr 0x01) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

7.2.1

Serial audio input interface format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

7.2.2

Serial data interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

7.2.3

Serial data first bit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

7.2.4

Delay serial clock enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

7.2.5

Channel input mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

7.3

Configuration register C (addr 0x02) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

7.3.1

FFX power output mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

7.3.2

FFX compensating pulse size register . . . . . . . . . . . . . . . . . . . . . . . . . . 34

7.3.3

Overcurrent warning detect adjustment bypass . . . . . . . . . . . . . . . . . . 35

7.4

Configuration register D (addr 0x03) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

7.4.1

High-pass filter bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

7.4.2

De-emphasis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

7.4.3

DSP bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

7.4.4

Post-scale link . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

7.4.5

Biquad coefficient link . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

7.4.6

Dynamic range compression/anti-clipping bit . . . . . . . . . . . . . . . . . . . . 36

7.4.7

Zero-detect mute enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

7.4.8

Submix mode enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

7.5

Configuration register E (addr 0x04) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

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