TUSB5052 datasheet(8/84 Pages) TI

8 / 84 page

viii

List of Tables

Table

Title

Page

3–1 Controller Pin Description (100-pin TQFP)

3–1

. . . . . . . . . . . . . . . . . . . . . . . . . . .

3–2 Internal/External Microcontroller Signals Defintion

3–4

. . . . . . . . . . . . . . . . . . . . .

3–3 Relation Between LEDs Signal and Hub-Port States

3–4

. . . . . . . . . . . . . . . . . . .

3–4 Signals Used for External Microcontroller

3–5

. . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–1 ROM/RAM Size Defintion Table

4–2

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–2 XDATA Space

4–3

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–3 Memory Mapped Registers Summary (XDATA Range = FF80

→ FFFF)

4–4

. .

4–4 EDB Memory Locations

4–6

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–5 EDB Entries in RAM (n = 1 to 7)

4–7

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

4–6 Input/Output EDB-0 Registers

4–11

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

6–1 DMA Channel Allocation

6–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

6–2 DMA OUT-Termination Condition

6–3

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

6–3 DMA IN-Termination Condition

6–5

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–1 UART Registers Summary

7–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–2 Transmitter Flow-Control Modes

7–4

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–3 Receiver Flow-Control Possibilities

7–4

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7–4 DLL/DLH Values and Resulted Baud Rates

7–8

. . . . . . . . . . . . . . . . . . . . . . . . . . .

8–1 Parallel Port Registers

8–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8–2 Parallel Port Mode Summary

8–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8–3 Parallel Port Signal Definition Summary

8–2

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8–4 PP Output-Pins Activation Source

8–4

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

9–1 8052 Interrupt Location Map

9–1

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

9–2 Vector Interrupt Values

9–3

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

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